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verilog中有哪幾種類型的賦值語句，說明它們的區別，并舉例
在Verilog中有兩種類型的賦值語句連續賦值和過程賦值賦值表達式由三個部分組成左值賦值運算符=或<=和右值右值可以是任何類型的數據包括net型和register型但對連續賦值左值必須是net類型的數據而過程賦值左值必須是register類型的數據下面將作詳細描述1連續賦值在initial或always外的assign賦值語句稱為連續賦值語句一般在描述純組合電路時使用例如wireout//類型定義左值必須是net類型包括wiretriwandwor等等assignout=a+b//綜合結果為加法器assignout=en?a:b//多路選擇器assignout=en?in:Z//三態門也可以在數據定義時同時進行連續賦值如wireout=a+b使用連續賦值語句所有右值都是敏感信號當右值發生變化時計算表達式的值并將結果傳給左值具有組合電路的特性輸入變化輸出立即變化2過程賦值在initial或always塊中的賦值語句稱為過程賦值語句包括三種Blocking賦值Non-blocking賦值和過程連續賦值assign/deassignBlocking賦值與順序相關的而Non-blocking賦值與順序無關一般來說使用Non-blocking賦值描述時序邏輯電路使用Blocking賦值語句描述組合邏輯電路例如regX,Y,Z;//Non-blockingassignmentalways@(posedgeClk)beginX<=A&&B;Y<=X;Z<=Y;endregX,Y,Z;//Blockingassignmentalways@(posedgeClk)beginX=A&&B;Y=X;Z=Y;end在Verilog中有兩種類型的賦值語句連續賦值和過程賦值賦值表達式由三個部分組成左值賦值運算符=或<=和右值右值可以是任何類型的數據包括net型和register型但對連續賦值左值必須是net類型的數據而過程賦值左值必須是register類型的數據下面將作詳細描述1連續賦值在initial或always外的assign賦值語句稱為連續賦值語句一般在描述純組合電路時使用例如wireout//類型定義左值必須是net類型包括wiretriwandwor等等assignout=a+b//綜合結果為加法器assignout=en?a:b//多路選擇器assignout=en?in:Z//三態門也可以在數據定義時同時進行連續賦值如wireout=a+b使用連續賦值語句所有右值都是敏感信號當右值發生變化時計算表達式的值并將結果傳給左值具有組合電路的特性輸入變化輸出立即變化2過程賦值在initial或always塊中的賦值語句稱為過程賦值語句包括三種Blocking賦值Non-blocking賦值和過程連續賦值assign/deassignBlocking賦值與順序相關的而Non-blocking賦值與順序無關一般來說使用Non-blocking賦值描述時序邏輯電路使用Blocking賦值語句描述組合邏輯電路例如regX,Y,Z;//Non-blockingassignmentalways@(posedgeClk)beginX<=A&&B;Y<=X;Z<=Y;endregX,Y,Z;//Blockingassignmentalways@(posedgeClk)beginX=A&&B;Y=X;Z=Y;end
vhdl中的或 “or”，和 “|”，有什么區別
VHDL中的“or”是表示或的運算，沒有“1”；verilogHDL中“1”表示或的運算。
verilog 2位輪轉優先級仲裁器咋設計
定義一個五位的寄存器L，從低到高分別存放五個數據的最低位，即L<={b4[0],b3[0],b2[0],b1[0],b0[0]}這樣通過一個簡單的拼接運算符就實現了；最后把L輸入到仲裁器不就好了么
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